Validation du layout sur la carte terminée - vérifier la gigue, la CEM et le comportement au démarrage

Validation du layout sur la carte terminée - vérifier la gigue, la CEM et le comportement au démarrage

Méthodes de mesure pratiques pour le post "Adaptation optimale des quartz aux CI" - Sections G et 6

Article encyclopédique : Adapter les quartz aux CI

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De quoi il s'agit

Un mauvais layout de circuit imprimé peut rendre inutilisable même un quartz choisi de manière optimale. En même temps, le layout affecte plusieurs propriétés en même temps - capacités parasites, |-Rneg|-réserve, gigue, comportement CEM et réponse transitoire. Ce post décrit un test structuré qui permet de valider finalement un layout de quartz sur la carte terminée.

Liste de contrôle du layout (vérification du design)

Avant la mesure, le layout est vérifié par rapport aux règles de conception établies :

RègleCritèreExamen
PositionQuartz + C1, C2 directement sur ICDistance &lt ; 5 mm à XIN/XOUT
SymétrieLignes C1/C2 de même longueur±1 mm de différence
IsolationAucun signal sous ou à côté du quartzEn anneau de coin autour du quartz ≥ 2 mm
Surface de massePas de surface GND directement sous le quartzÉcart sur toutes les couches
îlot GNDEspace GND dédié pour C1, C2Lien propre au GND principal
Boîtier en quartzPads #2/#4 sur GND (céramique à 4 pads)connexion directe, &lt ; 1 mm
ProtectionPas de changement de couches sous le quartzDes contacts en dehors
EMVDistance aux lignes d'horloge≥ 5 mm par rapport aux lignes d'horloge
Trajectoires d'humidité/de fluageDistance de revêtement conformeConsidérer les environnements difficiles

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Validation de la mise en page à l'aide de mesures

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Les mesures suivantes sur la carte terminée révèlent les faiblesses typiques du layout :

Validation 1 : mesure du jitter à la sortie de l'oscillateur

  • Oscilloscope ≥ 1 GHz avec fonction d'analyse de la gigue (gigue de période, gigue de cycle à cycle)
  • Point de mesure : sortie du signal d'horloge piloté par l'oscillateur à quartz (sortie PLL, broche SYSCLK, broche de débit UART)
  • Exigence : gigue de période &lt ; 30 ps RMS pour applications standard ; &lt ; 10 ps RMS pour USB, Ethernet, HDMI

Une gigue élevée (&gt ; 50 ps RMS) indique des couplages à partir de signaux voisins, une mise à la masse incorrecte ou un niveau de commande trop bas.

Validation 2 : Pré-test CEM - Sonde de champ proche

  • Sonde de champ proche (champ H, 10 - 30 mm de diamètre) avec analyseur de spectre ou Signalhound BB60C
  • Scanner la surface au-dessus du quartz, des condensateurs et du CI
  • Expectation : fréquence fondamentale visible, nettement dominante. Harmoniques atténuées.

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Signaux d'alarme : harmoniques élevées (&gt ; 3e ordre) ou émissions claires à des endroits éloignés du quartz indiquent des couplages et des problèmes de layout. (Voir également à ce sujet l'exemple de cas https://www.petermann-technik.de/praxis-wissen/40mhz-quarz-emv-verbessern-fallbeispiel.html

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Validation 3 : résistance au couplage VCC

  • Injecter un injecteur de bruit ou un générateur de fonctions dans la ligne VCC (50 - 200 mVpp de bruit, bande passante 10 kHz - 100 MHz)
  • Observer la stabilité de la fréquence et la gigue en sortie

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Expectative : la fréquence varie de &lt ; 2 ppm, la gigue reste dans les limites spécifiées. Les fortes oscillations indiquent un découplage VCC local insuffisant au niveau du circuit intégré de l'oscillateur.

Validation 4 : démarrage à froid

  • Chambre climatique à -40 °C (ou spray réfrigérant), VCC à Vmin
  • Au moins 30 mises sous tension. Chacun doit vibrer en toute sécurité (voir le post sur le temps de démarrage)

Erreur de layout la plus fréquente rencontrée ici : Cpar trop élevé, ce qui fait que |-Rneg| tombe sous BVR dans le pire des cas.

Validation 5 : Profil de température sur le boîtier du quartz

  • Caméra mobile thermique ou thermocouple directement sur le boîtier en quartz
  • Espérance : boîtier en quartz &lt ; 5 K au-dessus de la température ambiante

Si le quartz se réchauffe nettement (&gt ; 10 K), le niveau de drive est trop élevé - voir post sur la mesure du niveau de drive. Les conséquences sont un vieillissement accéléré et une dérive.

Défauts de layout fréquents et leur signature de mesure

Erreurs de mise en pageSignature de mesure typiqueAide
Surface GND sous quartzDécalage de fréquence +5 à +20 ppm, Cpar &gt ; 4 pFEncoche GND sur toutes les couches
Conducteurs longs (&gt ; 10 mm)Jitter augmenté, temps de démarrage prolongéRaccourcir le routage, rapprocher le quartz du CI
C1/C2 placé de manière asymétriqueAmplitudes différentes sur XIN/XOUT, niveau de drive asymétriqueRoutage symétrique
Ligne d'horloge proche du quartzBandes latérales dans le spectre, gigue de phase accrueEspacement ≥ 5 mm, le cas échéant. Conducteur GND entre les deux
Pas de condensateur de blocage local (100 nF) sur IC VCCDérive de la fréquence lors des changements de charge100 nF + 10 nF aussi près que possible du CI
Passage sous quartzJitter accru, mauvaise CEMEspace libre sous le quartz, adapter le routage
Pads de boîtier en quartz flottantsSensible à la proximité de la main, couplage CEMPads #2/#4 directement sur GND

Validation finale du design

Avant la validation de la série, nous recommandons un tableau de contrôle récapitulatif. Tous les points doivent être réussis au point de fonctionnement le plus défavorable (Vmin, -40 °C ou +85 °C selon l'application, tolérance de construction du pire cas):

Point de contrôleDestinationAcceptation
Précision de la fréquence à +25 °C, Vnom± &lt ; 5 ppmPass
Gain-Margin (|-Rneg| / ESR) Worst-Case≥ 3 (Industrie) / ≥ 5 (Automobile)PassStart-Up-Time Worst-Case&lt ; 3× valeur typique à +25 °CPass
Drive-Level≤ 60 % de la valeur de la feuille de données du quartzPasseport
Jitter de période&lt ; Demande d'applicationPasseport
Cpar de la méthode de fréquencedans l'hypothèse de conception ±0,5 pFPasseport
Contrôle du champ proche VEMpas d'émissions remarquables sauf fréquence utile du quartzPasse
Test de cycle de température 10 cycles -40/+85 °Cpas de panne au démarrage, pas de dérive &gt ; 10 ppmPass

La meilleure pratique de mise en page en trois lignes

Les règles essentielles en un clin d'œil

1. Quartz + C1, C2 compacts et directement sur le CI, routage symétrique, lignes courtes.

2. Pas de surface GND et pas de signaux sous le quartz, îlot GND dédié pour les condensateurs.

3. Pastilles de boîtier #2/#4 sur GND pour les quartz céramiques à 4 pastilles - définir cette connexion tôt et ne plus la modifier plus tard pour l'équilibrage des fréquences.

Pour aller plus loin

Les principes de layout sont présentés dans le guide pratique "Adapter les quartz de manière optimale aux CI" (sections G et 6). Ce post complète le guide par la validation assistée par des mesures sur la carte terminée - du contrôle de la gigue à l'acceptation du pire cas.

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FAQs

Comment un layout en quartz est-il validé par des mesures sur la carte terminée ?

La validation métrologique d'un layout de quartz sur la carte terminée s'effectue de manière structurée par le biais de plusieurs tests qui mettent en évidence les faiblesses typiques du layout. Il s'agit notamment de la mesure de la gigue à la sortie de l'oscillateur, d'un pré-test CEM avec une sonde de champ proche, du contrôle de la résistance du couplage VCC, du test de démarrage à froid et de la mesure de la température directement sur le boîtier du quartz. Avant ces mesures, le layout devrait déjà être testé par rapport aux règles de conception établies, afin que les erreurs évidentes soient détectées rapidement. Il est décisif que tous les tests soient également effectués au point de fonctionnement le plus défavorable, c'est-à-dire avec une tension d'alimentation minimale, une température critique et des tolérances de composants. Ce n'est qu'une fois que la carte a passé cette validation avec succès que l'on dispose d'une base solide pour la validation de la production en série.

Quelles sont les limites de la gigue lors de la validation du layout des circuits à quartz et des oscillateurs ?

Lors de la validation du layout, la mesure de la gigue est un indicateur central de la qualité de la génération d'horloge sur la carte finie. Le site indique comme valeur attendue pour les applications standard une gigue de période de moins de 30 ps RMS, tandis que pour les interfaces exigeantes comme USB, Ethernet ou HDMI, on vise moins de 10 ps RMS. Une gigue élevée de plus de 50 ps RMS indique des problèmes de layout comme des couplages de signaux voisins, une mise à la masse imprécise ou un niveau d'entraînement trop bas. La mesure est effectuée à la sortie du signal d'horloge piloté par l'oscillateur à quartz, par exemple à la sortie de la PLL, à la broche SYSCLK ou à la broche de débit UART. Pour obtenir des résultats fiables, il faut utiliser un oscilloscope avec une bande passante d'au moins 1 GHz et une fonction d'analyse de la gigue pour la gigue de période et la gigue de cycle à cycle.

Comment reconnaître les problèmes CEM dans la disposition des quartz sur le circuit imprimé ?

Les problèmes de CEM dans l'agencement du quartz peuvent être facilement détectés sur la carte terminée à l'aide d'une sonde de champ proche et d'un analyseur de spectre. La surface au-dessus du quartz, des condensateurs de charge et du circuit intégré de l'oscillateur est systématiquement balayée afin de rendre visible le rayonnement local. On s'attend à ce que la fréquence fondamentale domine clairement et que les harmoniques supérieures soient nettement atténuées. L'apparition d'harmoniques élevées au-dessus du troisième ordre ou d'émissions claires à des endroits éloignés du quartz est un signe de couplage indésirable et d'erreurs de conception. De telles signatures de mesure permettent d'identifier de manière ciblée les problèmes de guidage des conducteurs, de connexion à la masse ou de découplage.

Pourquoi le contrôle de la résistance au couplage VCC est-il si important pour les layouts en quartz ?

Le test de la résistance du couplage VCC montre à quel point le circuit de l'oscillateur est conçu pour résister aux perturbations sur la tension d'alimentation. Pour ce faire, un bruit ciblé de 50 à 200 mVpp et d'une largeur de bande de 10 kHz à 100 MHz est injecté dans la ligne VCC, tandis que la stabilité de la fréquence et la gigue sont observées à la sortie. Dans le cas idéal, la fréquence varie de moins de 2 ppm et la gigue reste dans les limites spécifiées. Des écarts importants indiquent un découplage VCC local insuffisant au niveau du circuit intégré de l'oscillateur. Cette validation est particulièrement importante, car les couplages d'alimentation sont fréquents dans le fonctionnement réel du système et peuvent influencer directement la qualité de l'horloge.

Quelles sont les erreurs typiques de layout qui apparaissent lors du démarrage à froid et de la mesure de la température du quartz ?

Lors du test de démarrage à froid et de la mesure de la température, les faiblesses typiques d'un layout à quartz apparaissent particulièrement clairement. Lors du test de démarrage en chambre climatique à -40 °C ou avec un spray réfrigérant, ainsi qu'avec une tension d'alimentation minimale, l'oscillateur doit osciller de manière sûre en au moins 30 cycles de démarrage. S'il n'y a pas d'oscillation ou si elle est instable, il y a souvent une capacité parasite trop élevée, de sorte que la réserve |-Rneg| tombe en dessous de la valeur ESR dans le pire des cas. En complément, la mesure de la température du boîtier du quartz montre si le niveau de drive est correctement choisi. Si le boîtier s'échauffe de plus de 5 K par rapport à l'environnement ou même nettement plus de 10 K, le quartz est trop excité, ce qui peut accélérer le vieillissement et la dérive de fréquence.

Pourquoi PETERMANN-TECHNIK Validation du layout sur la carte terminée - vérifier la gigue, la CEM et le comportement au démarrage ?

PETERMANN-TECHNIK est spécialisée dans les quartz, les oscillateurs et les composants générateurs de fréquence et allie le savoir-faire en matière de composants à des compétences pratiques en matière de mesure et de layout. L'entreprise ne se contente pas de vous aider à choisir le quartz adéquat, elle vous assiste également dans les mesures directement dans votre circuit et dans l'accompagnement du design-in jusqu'à la validation de la production en série. Cette combinaison de théorie et de validation sur la carte finie est particulièrement précieuse pour des sujets tels que la gigue, la CEM, la résistance au couplage VCC et le comportement de démarrage sûr. La procédure structurée aide à identifier de manière fiable les erreurs de layout critiques avant la production en série et à les évaluer de manière techniquement fondée. Pour les applications industrielles B2B, cela signifie une plus grande sécurité de développement, un risque réduit sur le terrain et une validation robuste dans les pires conditions.

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